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设计触发器

发布时间: 2021-01-04 14:11:48

Ⅰ 触发器在数据库设计和编程中起到什么重要作用

我的讲解:
简单来讲哪就是事件触发。
比如你对数据库中的表进行了一个插删等操作,你想在你即将做或者完成这个操作的时候程序能自动做一点别的工作,比如你想对插入数据检查一下或者对删除后的数据总数进行一下统计。

本来哪,你可以把这个工作写在自己的程序里,就是把检查写在你插入动作之前或者把统计数目写在删除动作之后。这样的问题是:你要做插删的时候就都要写这些代码,而且很容易就遗漏了。

而触发器哪,你定义在某个操作上,比如把那个检查的工作过程定义成插入的前触发器,把统计工作定义成后触发器,那么在你进行插入删除的时候,数据库那边的程序就自动的给你做了这个工作了。

主要作用哪:我感觉
一是完整性(防止自己编程的遗漏),
二是简单,
三是由数据库程序(比如Oracle)进行这项工作,而不是由你自己的程序做,效率高。

下面是人家的一些教程,其实道理是很简单的。你可以用它后面讲的几个数据库的例子,自己写一个,试试就知道了。

————————————————————————————————————————

一 触发器介绍

触发器是一种特殊的存储过程,它在插入,删除或修改特定表中

的数据时触发执行,它比数据库本身标准的功能有更精细和更复杂的

数据控制能力。数据库触发器有以下的作用:

* 安全性。可以基于数据库的值使用户具有操作数据库的某种权

利。

# 可以基于时间限制用户的操作,例如不允许下班后和节假日

修改数据库数据。

# 可以基于数据库中的数据限制用户的操作,例如不允许股票

的价格的升幅一次超过10%。

* 审计。可以跟踪用户对数据库的操作。

# 审计用户操作数据库的语句。

# 把用户对数据库的更新写入审计表。

* 实现复杂的数据完整性规则。

# 实现非标准的数据完整性检查和约束。触发器可产生比规则

更为复杂的限制。与规则不同,触发器可以引用列或数据库对

象。例如,触发器可回退任何企图吃进超过自己保证金的期货。

# 提供可变的缺省值。

* 实现复杂的非标准的数据库相关完整性规则。触发器可以对数

据库中相关的表进行连环更新。例如,在auths表author_code列上的

删除触发器可导致相应删除在其它表中的与之匹配的行。

# 在修改或删除时级联修改或删除其它表中的与之匹配的行。

# 在修改或删除时把其它表中的与之匹配的行设成NULL值。

# 在修改或删除时把其它表中的与之匹配的行级联设成缺省值。

# 触发器能够拒绝或回退那些破坏相关完整性的变化,取消试

图进行数据更新的事务。当插入一个与其主健不匹配的外部键

时,这种触发器会起作用。例如,可以在books.author_code

列上生成一个插入触发器,如果新值与auths.author_code列

中的某值不匹配时,插入被回退。

* 同步实时地复制表中的数据。

* 自动计算数据值,如果数据的值达到了一定的要求,则进行特

定的处理。例如,如果公司的帐号上的资金低于5万元则立即给财务人

员发送警告数据。

ORACLE与SYBASE数据库的触发器有一定的区别,下面将分别讲述

这两种数据库触发器的作用和写法。

二 ORACLE 触发器

ORACLE产生数据库触发器的语法为:

create [or replace] trigger 触发器名 触发时间 触发事件

on 表名

[for each row]

pl/sql 语句

其中:

触发器名:触发器对象的名称。由于触发器是数据库自动执行

的,因此该名称只是一个名称,没有实质的用途。

触发时间:指明触发器何时执行,该值可取:

before---表示在数据库动作之前触发器执行;

after---表示在数据库动作之后出发器执行。

触发事件:指明哪些数据库动作会触发此触发器:

insert:数据库插入会触发此触发器;

update:数据库修改会触发此触发器;

delete:数据库删除会触发此触发器。

表 名:数据库触发器所在的表。

for each row:对表的每一行触发器执行一次。如果没有这一

选项,则只对整个表执行一次。

举例:下面的触发器在更新表auths之前触发,目的是不允许在

周末修改表:

create trigger auth_secure

before insert or update or delete //对整表更新前触发

on auths

begin

if(to_char(sysdate,'DY')='SUN'

RAISE_APPLICATION_ERROR(-20600,'不能在周末修改表auths');

end if;

end

三 SYBASE数据库触发器

SYBASE数据库触发器的作用与ORACLE非常类似,仅有较小的差异。

SYBASE产生触发器的语法为:

CREATE TRIGGER 触发器名

ON 表名

FOR INSERT,UPDATE,DELETE

AS

SQL_statement |

FOR INSERT,UPDATE

AS

IF UPDATE(column_name) [AND|OR UPDATE(column_name)]...

SQL_statements

上面FOR子句用来指定在触发器上的哪些数据更新命令可激活该

触发器。IF UPDATE子句检查对指定列的操作类型,在IF UPDATE子句

中可指定多个列。

与ORACLE不同,对于每条SQL语句,触发器只执行一次。触发器

在数据更新语句完成以后立即执行。触发器和启动它的语句被当作一

个事务处理,事务可以在触发器中回退。

下面举例说明SYBASE触发器的写法。

create trigger forinsert_books

on books

for insert

as

if(select count(*) from auths,inserted

where auths.author_code=insert.author_code)!=@@rowcount

begin

rollback transaction

print "books 表中 author_code 列的值在auths 表中不存在。"

end

Ⅱ 利用D触发器设计4分频电路,设计步骤自拟

1、每个D触发器的的输入端均接该触发器的Q`输出端,下一态为现态的“反”。
2、CP输入端并联,成为同步时序电路。
Q3Q2Q1Q0的 初始态为0000,时序变化规律为:
0000→0001→0010→0011→0100………1110→1111→0000

Ⅲ 设计一个8分频电路,至少需要几个触发器

三个就行了,都设计成T'触发器,然后串联就行了

Ⅳ 怎样用两个D触发器设计一个二分频电路

用一个D触发器就能设计一个二分频电路。

Ⅳ 设计电路(将D触发器转换成JK触发器)

你好,给你完成的。

Ⅵ D触发器 设计他的作用是什么

1、出现脉冲边沿才将数据送出,可用于时序电路
2、用边沿触发,可以防止信号传输过程中,外来干扰影响传输的正确性

我觉得主要是这两点

Ⅶ 为什么要设计边沿触发的触发器呢

触发器分为电平触发和边沿触发两类。
电平触发的触发器原理较简单,学习触发器时,一般回先学习电平答触发。
电平触发的触发器主要是基本RS触发器
基本RS触发器由电平触发,并且有一个重要的约束条件:/SD和/RD不能同时为零。即:/SD+/RD=1。
许多时候,我们希望触发器只有在时钟来临时,输出状态改变,其它时候,触发器维持,因为这样做可以让多个电路单元的状态同时得以改变,这个时钟,我们称为同步时钟。
同步RS触发器与基本RS触发器的不同之处在于,只有时钟CP=1的时候,输出状态才能被改变。但是,同步触发器也具有一个约束条件,就是当CP=1时,S和R不能同时为1。
此外,同步RS触发器还有一个不足之处在于:当CP=1时,S和R若多次改变,每次改变都会影响输出。这种现象,称为空翻现象。
主从触发器的输出改变仅仅取决于CP的下降沿时刻。有效的解决了空翻问题。但是,主从RS触发器仍然存在约束条件:R、S不能同时为1。
若将主从RS触发器的两个输出分别反馈至输入,即可解除这个约束。这就是JK触发器。
实际应用的触发器,大多是在JK触发器基础上作出简单的变更得到的。

Ⅷ 用VHDL设计D触发器

伙计分点少了

呵呵

不过还是帮你一下吧

源程序和仿真波形:

libraryieee;

useieee.std_logic_1164.all;

useieee.std_logic_unsigned.all;

entitym6is

port(clk,rst:instd_logic;

q:outstd_logic_vector(2downto0));

endm6;

architecturebhvofm6is

typestatesis(st0,st1,st2,st3,st4,st5);

signalstx:states;

begin

process(clk)

begin

ifrst='1'thenstx<=st0;q<="000";

elsifclk'eventandclk='1'then

case(stx)is

whenst0=>q<="000";stx<=st1;

whenst1=>q<="001";stx<=st2;

whenst2=>q<="011";stx<=st3;

whenst3=>q<="111";stx<=st4;

whenst4=>q<="101";stx<=st5;

whenst5=>q<="100";stx<=st0;

whenothers=>stx<=st0;

endcase;

endif;

endprocess;

endbhv;

Ⅸ 设计一个3进制计数器需要多少个触发器 请高手速回!谢谢!

4个
十进制即十种状态,需要4位来表示,每一位需要一个触发器,所以要四个

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